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圖1示出TPS54350的實際應用電路，圖中給出的是其中一種情況，其輸出電壓是可變的，通過改變電阻器R2的阻值，可得到期望的輸出電壓值
系統組成及供電電路
本信號處理系統采用的是ADl公司的TS201S型ADSP組成的多片某仿真雷達信號處理系統.系統主要由5個DSP、1個FPGA和7個TPS54350組成。在以往使用的MAXl951和。PEGlll7的經驗基礎上.經過多方面的設計考慮，采用了TPS54350型DC/DC變換器.從表1可以看出.TPS54350可以輸出3.3 V、2.5 V和1.2V的電壓。系統中的DSP采用240 MHz時鐘，每個指令周期約為4.17 ns。根據TS201S型ADSP的工作條件可知，當溫度為25℃、時鐘CCLK(為250 MHz時，典型情況下的VDD(1.25V)供電電流典型值為1.2 A，VDD的供電電流小于137 mA。TPS54350的額定輸出電壓為3 A.所以此系統的設計是合理的。
TigerShar DSP有3個電源，其中數字2.5 V(VDD_Io)為I/0供電;數字1.2 V(VDD)為DSP內核供電;模擬1.2 V(VDD_A)內部鎖相環和倍頻電路供電。系統將主機提供的5V,經過TPS54350得到2.5V和1.2 V的電壓。各片DSP的數字1.2V(VDD)電源各由1個TPS54350供給。5個。DSP內部模塊1.2V(VDD)由同一個。DSP的VDD(+1.2V)經濾波網絡后解決。5個。DSP的FO 2.5V電源直接由主機提供的5V經過TPS54350得到2.5V統一供給，同時提供FPGA(EPU1。K30)的VccM(+2.5 V)電壓。其中FPGA的Vcc_IO(+3.3V)利用TPS54350輸出的+3.3V電壓來供電。本系統的供電電路框圖如圖2所示。圖3示出單個DSP的內核供電電路框圖及外圍電路配置。
T37S54350采用小型16引腳HTSSOP封裝。根據以往的經驗，建議設計PC板時**給TPS54350加上散熱片，電源線盡量粗一點。在TPS54350的前后均加上濾波網絡，盡量保證得到比較合適的電壓。
系統中的EPlK30產生上電復位波形和時序控制。由于EPlK30需要一個配置電路，而且它和DSP存在一個上電先后的問題。即在上電后，如果FPGA完成配置文件的讀入時.DSP仍未上電穩定.則應充分延長TStart_I0的低電平時間，以避免DSP上電未穩定而FPGA上電波形已結束的情況發生。因此。應保證DSP上電穩定先于FPGA配置文件的讀入，此問題在系統設計時應予以充分重視.否則DSP將無法正常工作。TigerSharc TS201S要求數字2.5V和l-2V應同時上電。若無法嚴格同步，則應保證內核1.2V電源先上電.I/0的2.5 V電源后上電。本系統在數字2.5 V輸入端并聯了一個大容量電容器.在數字1.2 V輸入端并聯了一個小容量電容器.其目的就是為了保證2.5V充電時間大于1.2V充電時間.來解決電源供電先后的問題。

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資訊來源：名站在線